一种用于ARM处理器的增强DSP乘加单元

摘要：

介绍了一种应用于ARM处理器的增强DSP功能乘加单元.为了减小乘加指令的周期数,采用了两个并行16×16位乘加单元构成的单指令多数据(SIMD)结构,可以通过适当的配置支持16到32位的各种乘加运算以及16位的复数乘法.理论分析表明,这种乘加单元与传统的单指令单数据(SISD)结构相比在周期数上有明显的减小.尤其对于16位乘加及16位复数乘法,其所需周期数分别只有ARM1022E的1/4和1/3.0.35μm的标准单元库实现表明该乘加单元可以工作在120MHz,使得其非常适合数字信号处理的应用.

关键词：乘加单元、乘法器、单指令多数据:微处理器、ARM、数字信号处理

所属期刊栏目：28

分类号：TN47(微电子学、集成电路（IC）)

在线出版日期：2004-01-08（万方平台首次上网日期，不代表论文的发表时间）

页数：共4页

页码：61-64